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東芝65納米設計采用Cadence QRC EXTRACTION

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作者： 時間：2006-08-31 來源：www.ednchina.com
　　Cadence設計系統公司宣布東芝已采用Cadence® QRC Extraction，用于其最先進的65納米設計流程。Cadence QRCExtraction為下一代工藝節點提供硅精確的寄生參數提取，包括基于敏感性和化學機械拋光（CMP）模型的提取。 　　  

　　Cadence QRC Extraction可為基于單元的數字設計提供超越其它提取技術的有制造意識的硅精度。通過其分布于多重網絡處理器和計算集群的近似線性性能伸縮，它可顯著減少處理時間。它還為Cadence Encounter®數字IC設計平臺提供強大的多邊際條件支持和精確的增量式基于設計提交（signoff）的參數提取。 　   

 
　　Cadence的產品分割策略針對特定級別的設計復雜性，為客戶提供多種級別技術。Cadence QRC Extraction有L、XL、和GXL系列產品可供選擇。

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